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[转]Altera Arria10 FPGA PCIe Avalon-MM DMA设计

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本文链接：https://blog.csdn.net/Zhu_Zhu_2009/article/details/80793919 FPGA设计 DMA原理框图如下，实际应用中把双口RAM换成自己的IP即可，首先使能了内部Descriptor Controller，那么BAR0默认连接到了Descriptor，若想通过PCIe BAR来访问寄存器，就必须得添加一个BAR4，其实可以不用使能内部的Descriptor Controller，自己添加DMA IP，手动在Qsys中连线，这样一个BAR就够了。Read Data Mover从PC读数据，这里Read Data Mover连接了两个设备，一个是Descriptor Controller内部的FIFO，用来存放DMA描述符的，另外的就是自己的数据源，Write Data Mover将数据发送到PC。 Qsys连接图如下，其中wr_dts_slave和rd_dts_slave是Descriptor Controller内部的FIFO接口，这里分配的地址是0x08012000和0x08010000，这儿分配看实际需要，这儿的地址空间不能喝自己逻辑使用的冲突即可。另一个BAR4的空间设置了地址0x08000000，BAR4的空间占用不易过大，适当是最好的。另外wr_dcm_master和rd_dcm_master连接到了Txs端口

PC机上常用 EDA 软件

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http://bbs.fudan.edu.cn/bbs/tcon?bid=142&f=39 PC机上常用 EDA 软件介绍本站网址: http://eda163.com/ (一)altera公司软件 GNU tools and Excalibur V3.0(一张光盘) GNU tools and Excalibur 3.0。与Qu artus II v3.0 full同时推出的工具软件。 Excalibur_gnu_q40（一张光盘) GNU tools and Excalibur 4.0。与Quartus II v4.0 full同时推出的工具软件。 Maxplus II full V10.1(一张光盘) Maxplus II full 10.1,FULL版本确实不错，比 baseline强多了。。 MAX+PLUS II是一个完全集成的设计体系，包括设计输入、综合、仿真、布局布线以及时序分析。 Maxplus II full V10.2(一张光盘) Maxplus II full 10.2。MAX+PLUS II full 的新版本。 Modelsim oem V5.7c for Altera(一张光盘) Modelsim oem 5.7c for Altera。配套Quartus II v3.0 full使用的Modelsim OEM V5.7C版本。 Modelsim

Altera FPGA– Bit Slip

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通过在接收端加延时，在延时间隙插入‘0’或‘1’，以使最终接收和期望数据一致。 BitSlip操作要注意几点： 1，BitSlip操作在rx_bitslip的上升沿即开始； 2，BitSlip操作开始后，必须等待至少2个平行信号的时钟周期后，才可开始检查数据是否对齐；因为需要2个时钟周期清除受损数据。来源： https://www.cnblogs.com/freshair_cnblog/p/11356903.html

Quartus II 与 Vivado , Altera 与 Xilinx 科普贴

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1 软件硬件对因关系 Altera公司的芯片用 => Quartus II软件 (alterax硬件常用的有cyclone) ( altera公司生产的软件 ) xilinx的芯片需要用 => foundation或者ISE (配套的是foundation或者ISE软件) 学的是quartus，用xilinx的板子可以吗？不可以， altera公司生产的软件是quartus，配套的altera硬件常用的有cyclone等；与xilinx的芯片相配套的是foundation或者ISE软件总之，一个公司的硬件和软件要配套使２　初学建议 Altrea 的吧，毕竟资料多，开发板价钱也便宜，好上手Altrea已被Intel收购，谁知道以后的发展方向是啥 Xilinx 世界上的第一块FPGA由Xilinx生产，Xilinx的底蕴很强，很多大公司都在使用它的产品。 Xilinx的开发板主要是太贵了，资料也不像Altrea那么多来源： https://blog.csdn.net/zjc910997316/article/details/98877617